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  • 请问在DDR的布局中为什么我必须使用3-5mils

    ,让我们说整体SI分析会告诉你事情很好......那么......为什么我必须使用3-5mils?谢谢以上来自于谷歌翻译以下为原文Hello, Im reading UG388 now on page

    2019-06-11 11:12

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    求教:Allegro 16.5 测量单位如何同时显示 ?请大侠支招。如上设置 依然 只显示 100mils ,如何同时显示 2.54mm ??

    2013-09-05 16:42

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    过孔的单位和其他部分的单位好像不一致,导致过孔变成这样。有啥解决办法、单位是统一的。用的都是mils。这是怎么回事?朋友们知道吗?

    2015-01-29 14:29

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    ), but in this document they only refers to pcb boards with thickness of 0,508mm (20mils). The flex pcb is only 0.1mm

    2018-11-21 17:11

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    SSTL18_II_LR_33和SSTL18_OT25_LR_33。还尝试了不同的输出终端型号请注意,拓扑是与2500mils Microstipand的一对一连接,没有任何外部终端请帮忙。感谢致敬,Sivaraj.R

    2019-07-31 08:18

  • 如何将DQM0-DQM3引脚连接到FPGA

    口,哪种I / O标准对我的场景有好处?关于GTP的另一个问题如果想将GTP RX,TX和CLk信号路由到扩展头DO,我需要一个高速连接器或一般2mm / 100mils间距连接器也可以使用。此外

    2019-06-21 15:53

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    2021-01-08 07:10

  • (工程实践)DDR3 fly-by拓扑设计

    ;150mils,CTRL 走线stub<200mils,ADD/CMD走线 stub<260mils。感谢原理论分享着hampoo!longsoncd@sina.comlongsoncd

    2015-11-16 16:04

  • DDR SDRAM 类高速器件布线规则

    看懂,如果你看不懂,那么请按这样一个通用的基本法则做: (1)DDR和主控芯片尽量靠近(2)高速约束中设置所有信号、时钟线等长(最多允许50mils的冗余),所有信号、时钟线长度不超过1000mils(3

    2015-01-15 10:39

  • 对6678中SRIO进行PCB布线时,需要使用SRIO 4X模式时,PCB布线是否有必要对4组TX和RX差分信号分别进行等长处理?

    本帖最后由 一只耳朵怪 于 2018-6-25 14:19 编辑 1、在对6678中SRIO进行PCB布线时遇到一个疑问。若需要使用SRIO 4X模式时,PCB布线是否有必要对4组TX和RX差分信号分别进行等长处理?2、若不进行等长处理,4组差分信号的相位差应该控制在多少范围内?

    2018-06-25 04:40