VCS-MX的版本，可以混合编译Verilog和VHDL语言 由于在linux系统中个人用户各种权限被限制，导致很多地方无法正常使用软件之间的协调工作。 为了以防万一，在此以个人用户去实现vivado调用VCS仿真。
2018-07-05 03:30
，发现Modelsim10.5的版本也是可以使用的。笔者尝试过Modelsim10.4，发现该版本不支持。所以需要使用Vivado2017.3来调用Modelsim的工程师，需要选择正确的Modelsim版本。否者将调用
2019-03-30 09:51
在开发PL时一般都会用到分频或倍频，对晶振产生的时钟进行分频或倍频处理，产生系统时钟和复位信号，这是同步时序电路的关键，这时就需要使用到时钟向导IP，下面就介绍一下在vivado中进行PL开发时调用IP的方法。
2018-12-22 15:14
在开发PL时一般都会用到分频或倍频，对晶振产生的时钟进行分频或倍频处理，产生系统时钟和复位信号，下面就介绍一下在vivado2017.3中进行PL开发时调用IP的方法。
2018-12-22 14:26
Without External Memory，把代码和只读数据放在QSPI Flash中运行程序，这就是execute in place (XIP)。 上述XIP参考设计工作正常，但是只更新到了Vivado
2020-10-09 10:09
Vivado使用技巧的最大障碍，以至于两年多后的今天，仍有很多用户缺乏升级到Vivado的信心。本文介绍了Tcl在Vivado中的基础应用，希望起到抛砖引玉的作用，指引
2017-11-18 03:52
由目标运动引起的运动变化区域包括运动目标在前后两帧中的共同位置(图中黑色区域)、在当前帧中新显露出的背景区域和新覆盖的背景区域三部分。
2018-04-20 20:26
Xilinx的新一代设计套件Vivado相比上一代产品 ISE，在运行速度、算法优化和功能整合等很多方面都有了显著地改进。但是对初学者来说，新的约束语言 XDC 以及脚本语言 Tcl 的引入则成为
2023-04-15 09:43
关于Tcl在Vivado中的应用文章从Tcl的基本语法和在Vivado中的应用展开，介绍了如何扩展甚至是定制FPGA设计实现流程后，引出了一个更细节的应用场景：如何利用
2017-11-18 18:26
Codelabs 上有不少学习的案例，这次学习的是库的调用（ArkTS）案例。学习笔记拆成两部分，本文是关于社区库调用的学习笔记，以下我的学习心得，小白们也可以跟着一步步实现吖。 本次学习的案例由
2023-03-26 18:01
