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  • 详解芯片SDF文件 MCU芯片全流程设计

    SDF文件是在VCS/NC-Verilog后仿真运行时将STD/IO/Macro门级verilog中specify的延迟信息替换为QRC/Star-RC抽取的实际物理延时信息。

    2023-05-08 10:30

  • 分享芯片出SDF文件的一个“坑”

    不同于PT,Tempus会默认写出setuphold的负值。

    2023-05-08 14:12

  • 芯片后仿之SDF 3.0解析

    SDF文件是在VCS/NC-Verilog后仿真运行时将STD/IO/Macro门级verilog中specify的延迟信息替换为QRC/Star-RC抽取的实际物理延时信息,所以如果SDF

    2023-12-18 09:56

  • 解析SDF的Header Section信息与Cell Entries信息

    SDF文件是在VCS/NC-Verilog后仿真运行时将STD/IO/Macro门级verilog中specify的延迟信息替换为QRC/Star-RC抽取的实际物理延时信息。

    2023-05-06 09:54

  • 芯片后仿之SDF 3.0解析(三)

    本文接着解析SDF3.0的Timing Checks Entries、Timing Environment Entries两个部分。

    2024-04-16 11:08

  • 光学设计技术基础:Zemax与SPEOS光源文件格式

    .RAY、.SDF和.DAT的文件格式都是以二进制形式定义的。二进制光源文件包含一个数据头结构,然后是每条光线的数据。SPEOS和Zemax光源文件包含不同的数据标题信

    2023-02-09 11:34

  • 177倍加速!NVIDIA最新开源 | GPU加速各种SDF建图!

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    2023-11-09 16:46

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    焜炜SDF1355T-472 STM功率电感 等同 伍尔特WE-SL 744201。相同外形/相同尺寸/相同性能/相同封装。 伍尔特集团于1945年在德国成立,是世界上最大的电子元器件制造商之一

    2022-11-07 17:34

  • 芯片后仿及SDF反标

    相对于RTL仿真,门级仿真占用的计算资源虽然很多,但是在静态时序检查(STA)工具普遍应用之前,带时序的动态门级仿真几乎可以说是唯一的timing sign-off手段了。

    2023-06-08 10:07

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    2018-01-12 03:59