本实验活动介绍锁相环(PLL)。PLL电路有一些重要的应用，例如信号调制/解调（主要是频率和相位调制）、同步、时钟和数据恢复，以及倍频和频率合成。在这项实验中，您将建立一个简单的
2023-07-10 10:22
锁相环（PLL）电路是由压控振荡器（VCO）和鉴相器组成的反馈系统，振荡器信号跟踪施加的频率或相位调制信号是否具有正确的频率和相位。需要从固定低频率信号生成稳定的高输出频率时，或者需要频率快速变化时，都可以使用PLL。典型应用包括采用高频率、电信和测量技术
2020-10-06 14:43
在电子和通信领域，倍频器和锁相环(PLL)是两种常见的电路结构，它们在信号处理、频率合成和通信系统中扮演着重要角色。尽管两者在某些方面存在相似之处，但它们在功能、工作原理和应用领域等方面存在显著差异。本文将对倍频
2024-06-20 11:34
下图所示的是用 Q2230 激励锁相倍频系统实现的一个实际的 频率合成器 。系统时钟采用40 MHz，这样能输出DC～15 MHz、分辨率为0.01 Hz、电压峰一峰值为10 V的正弦波。谱纯度优于
2018-03-17 11:13
锁相环(PLL)是现代通信系统的基本构建模块，通常用在无线电接收机或发射机中，主要提供"本振"(LO)功能;也可用于时钟信号分配和降噪，而且越来越多地用作高采样速率模数或数模转换的时钟源。
2022-03-04 14:45
倍频器是指能完成输入信号频率倍增功能的电子组件，在工作频率较高而对频率稳定性要求严格的电子设备中，用一般的LC振荡器很难达到要求，若采用高稳定的晶振，通过倍频放大即可很容易的实现稳频要求。
2018-05-04 11:46
DS1080L是低抖动、基于晶振的时钟发生器，内部集成锁相环(PLL)，用于产生16MHz至134MHz的扩频时钟输出。该器件的时钟倍频速率和抖动幅度可通过引脚设置。DS1080L提供扩频禁用模式和关断模式，可节省功耗。
2025-04-15 09:59
当PLL参考时钟和PLL反馈时钟的频率和相位相匹配时，PLL则被称为是锁定状态。达到锁定状态所需的时间称为锁定时间，这是PLL设计最关键的参数之一。
2018-03-14 15:17
先用FPGA的外部输入时钟clk将FPGA的输入复位信号rst_n做异步复位、同步释放处理，然后这个复位信号输入PLL，同时将clk也输入PLL。设计的初衷是在PLL输出有效时钟之前，系统的其他部分都保持复位状态。
2020-03-29 17:19
当涉及多倍频程放大器时，以下是一些基础知识的详解。
2023-06-15 09:58
