本文主要使用了Cadence公司的时域分析工具对DDR3设计进行量化分析，介绍了影响信号完整性的主要因素对DDR3进行时序分析，通过分析结果进行改进及优化设计，提升信号
2014-07-24 11:11
Cadence 16.6 12层板高速PCB设计DDR3实例 视频教程
2014-09-23 01:20
在高速PCB设计中，DDR模块是绝对绕不过去的一关。无论你用的是DDR、DDR2还是
2025-04-29 13:51
针对DDR2-800和DDR3的PCB信号完整性设计，要认证看
2016-12-16 21:23
针对DDR2-800和DDR3的PCB信号完整性设计
2016-02-23 11:37
飞思卡尔DDR3硬件+PCB设计参考
2014-10-24 13:52
飞思卡尔DDR3硬件+PCB设计参考
2016-08-30 16:32
DDR3内存已经被广泛地使用，专业的PCB设计工程师会不可避免地会使用它来设计电路板。本文为您提出了一些关于DDR3信号正确扇出和走线的建议，这些建议同样也适用于高密度
2018-06-16 07:17
。在高速传输中确保传输线性能良好的关键是特性阻抗连续，确定高速PCB信号线的阻抗控制在一定的范围内，使印制板成为“可控阻抗板”，这是仿真分析的基础。
2014-12-15 14:17
本文章主要涉及到对DDR2和DDR3在PCB设计时，考虑信号完整性和电源完整性的设计事项，这些是具有相当大的挑战性的。 文章重点是讨论在尽可能少的
2021-03-25 14:26
