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2021-03-30 08:42
本期讲解的是高速PCB设计中DDR布线要求及绕等长要求。布线要求数据信号组：以地平面为参考，给信号回路提供完整的地平面。特征阻抗控制在50～60 Ω。线宽要求参考实施细
2017-10-16 15:30
PCB设计如何绕等长？阻抗会对信号速度产生影响吗？
2021-03-06 08:47
本文讲述了使用Altium designer设计SOC和DDR等高速PCB时候，如何设计信号线等长。DDR信号线分成两大部分。一是数据线部分，二是地址线、控
2025-07-28 16:33
本帖最后由 山文丰 于 2020-7-14 14:32 编辑 1、为什么要等长，等长的重要性。在 PCB 设计中，等长走线主要是针对一些高速的并行总线来讲的。由于
2020-07-14 14:30
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2021-04-05 08:47
1.关于等长 第一次听到“绕等长工程师”这个称号的时候，我和我的小伙伴们都惊呆了。每次在研讨会提起这个名词，很多人也都是会心一笑。 不知道从什么时候起，绕
2021-01-20 12:11
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2021-04-05 08:46
本文紧接着前一个文档《AD设计DDR3时等长设计技巧-数据线等长 》。本文着重讲解DDR地址线、控制信号线等长设计，因为
2025-07-29 16:14
有了单线的自动等长，那就肯定不会放过板上随处可见的差分了，看大招——Auto-interactive Phase Tune。现在板子的速率越来越高，板上的差分线也就跟着越来越多，对内等长的工作量自然就加大了。但是自从有了绕线新功能，就再也不担心
2018-10-19 15:33
