这两个都是CMOS逻辑门，那么是不是左边那个就是(A乘0)的非=1，，，右边那个就是(A乘1)的非=A的非？是不是也就是说除了接A的一段，另外一个输入端接电阻就是相当于
2016-03-03 15:31
伏安特性可知，当输入端接小于IKΩ的电阻时输入端的电压很小，相当于接低电平，所以可以通过接小于IKΩ（500Ω）的电阻到
2018-12-03 10:49
伏安特性可知，当输入端接小于IKΩ的电阻时输入端的电压很小，相当于接低电平，所以可以通过接小于IKΩ（500Ω）的电阻到
2018-08-30 11:18
最近项目在做通过xilinx的ZYNQ控制ADC采样。ADC准备采用ADS5545的CMOS输出模式。我在布板时用Hyperlynx仿真时发现有过冲现象，推荐串联33欧的端接电阻。想问一下在ADC的数据输出引脚需要串联33欧的
2024-12-10 06:24
）.9：Iil：逻辑门输入为低电平时的电流（为拉电流）.门电路输出极在集成单元内不接负载电阻而直接引出作为输出端,这种形式的门称为开路
2016-08-23 21:39
[url=]cmos传输门简介[/url]
2016-12-26 12:02
的输入端，做悬空处理，是非常不当的做法。CMOS电路的输入端是不允许悬空的，因为悬空会使电位不定，破坏正常的逻辑关系。另外，悬空时输入阻抗
2018-10-22 22:50
的输出阻抗，· ZIN 是接收器的输入阻抗。PS：这里仅显示CMOS和PECL/LVPECL电路。串行端接实际上，因为阻抗会随频率动态变化，难以达到阻抗匹配，所以缓冲器输出端可以省去
2019-09-27 07:30
高电平Uoh和输出低电平Uol Uoh≥2.4V,Uol≤0.4V 2.输入高电平和输入低电平 Uih≥2.0V，Uil≤0.8V CMOS电路 CMOS电路
2018-01-17 14:52
工程师们，你们好！我想做的是一个测量高阻器件上电压的电路，测量DC电压，器件阻抗大约是在几百兆。第一步做的是跟随，用的是JFET高输入阻抗的AD8512. 电路如图。但是问题是当正向
2023-11-27 06:45
