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  • 卷积码编码及译码算法的基本原理

    卷积码是一种信道纠错编码,在通信中具有广泛的应用。在发送端根据生成多项式进行卷积码编码,在接收端根据维特比(Viterbi译码算法进行译码,能够有效抵抗信道噪声的影响,在误码率门限之下可以对传输过程中发生的突发错误

    2022-04-28 15:02

  • 基于XC6SLX16-2CSG-324型FPGA实现Viterbi译码器的设计

    记(n0,k0,m)为卷积码编码器,该编码器共有2k0×m个状态,Viterbi译码器必须具备同样的2k0×m个状态发生器,且每个状态必须有一个存储路径度量值的存储器和一个存储幸存路径信息的存储器,所以Viterbi

    2020-07-15 20:53

  • 高速率低延时Viterbi译码器的设计与实现

    这样,2x时钟内读的2片RAM深度分别为2V,宽度2L-1个状态的1 bit路径信息,共计4V深度(按之前4V系统时钟内写入顺序标记为1a、1b,之后启动写2a、2b的深度为2V的2片RAM),写入2V深度之后启动回溯读出1b、1a;V深度后另一片读出2a、1b,这样回溯出1a、1b处的传输信息,同时写入2b、1a路径。

    2018-10-04 09:58

  • 译码器的分类和应用

    本文主要介绍了译码器的分类和应用。译码器指的是具有译码功能的逻辑电路,译码是编码的逆过程,它能将二进制代码翻译成代表某一特定含义的信号(即电路的某种状态),以表示其原来

    2018-04-04 11:51

  • 常用的译码电路有哪些

    常用的译码电路有哪些?本文主要介绍了IO接口地址译码电路、BCD译码驱动器电路、4线16线译码电路、3.8线译码器电路以

    2018-03-02 15:48

  • 译码器的逻辑功能_译码器的作用及工作原理

    本文首先介绍了译码器的定义与译码器的分类,其次介绍了译码器的作用和译码器的工作原理,最后介绍了译码器的逻辑功能。

    2018-02-08 14:04

  • 基于FPGA的极化码的SCL译码算法研究

    极化码的译码算法研究近年来发展迅速,其中成为研究热点的连续删除(Successive Cancellation,SC)译码算法的基本思想是通过对信息位的比特似然概率值的判断来进行译码

    2019-01-06 11:19

  • 地址译码电路设计实验报告

    地址译码有两种方式,一种是单译码方式,或称为字结构方式;另一种是双译码方式,或称为X-Y译码结构。

    2018-03-02 16:11

  • 二进制译码器和二-十进制译码器讲解

    译码是编码的逆过程,作用是将一组码转换为确定信息。

    2023-03-21 11:51

  • Wishbone部分地址译码的实现

    Wishbone部分地址译码的实现如图26所示。对于图中所示IP核,我们假设其只有4个地址,对应4组寄存器。地址译码器首先译码出其地址并给出选择信号,该选择信号与共享总线的STB_O相与输入到IP核的STB_I。而地

    2018-08-05 08:44