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00:05:35 [3.3.2]--VerilogHDL代码结构

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00:11:48 [4.2.1]--VerilogHDL--过程语句

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00:10:30 [3.2.1]--VerilogHDL语法（二）

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00:11:58 [3.1.1]--VerilogHDL语法（一）

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00:11:32 {3}--VerilogHDL建模实例

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00:11:10 #硬声创作季 #Verilog VerilogHDL设计与实战-06VerilogHDL的自定义原语(UDP)

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