作者：萨其日娜 内蒙古鲁电电力工程有限公司 摘要: 应用MicroBlaze软核作为CPU的硬件平台，在此平台上设计了基于AXI总线的通用实时时钟IP核。给出了创建
2017-11-17 16:34
在使用FPGA的时候，有些IP核是需要申请后才能使用的，本文介绍如何申请xilinx IP核的license。
2024-10-25 16:48
本文介绍了Vidado中FFT IP核的使用，具体内容为：调用IP核>>配置界面介绍>>IP
2024-11-06 09:51
Video In to AXI4-Stream IP核用于将视频源(带有同步信号的时钟并行视频数据，即同步sync或消隐blank信号或者而后者皆有)转换成AXI4-Stream接口形式，实现了接口转换。该
2025-04-03 09:28
对于IP核输出数据的解析最好的工具就是其自带的仿真文件，里面既将接收的数据进行了解析，又将发送给IP核的数据进行了封装，这对于了解数据结构和协议是十分有帮助的，以太网如
2018-07-09 14:07
有些时候，根据设计需求可能会想要修改IP核生成的源文件（只能修改未加密文件），包括HDL文件和XDC约束文件。这种修改不能直接修改源文件，因为在后续设计流程中，IP可能会复位或重新生成，导致修改操作被复原。本文将介绍
2022-08-25 14:38
学完SDRAM控制器后，可以感受到SDRAM的控制器的书写是十分麻烦的，因此在xilinx一些FPGA芯片内已经集成了相应的IP核来控制这些SDRAM，所以熟悉此类IP核
2019-11-10 10:28
第二项是器件添加，只有选择了相应的器件，你的IP核才能在那个器件里被使用。单击器件，右键——Add——Add Family Explicitiy，于是便可以选择要适用的器件系列了。
2018-11-12 14:31
用RAM实现一个DDS，从原理上来说很简单，在实际使用的时候，可能没有直接使用官方提供的IP核来的方便。这个博客就记录一下，最近使用到的这个DDS IP。
2024-10-25 16:54
在开发PL时一般都会用到分频或倍频，对晶振产生的时钟进行分频或倍频处理，产生系统时钟和复位信号，下面就介绍一下在vivado2017.3中进行PL开发时调用IP的方法。
2018-12-22 14:26
