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    我在Windows 7上使用vivado 2014.2。我有一个面临拥堵问题的设计,如附图中的粉红色区域所示。在设计中,我有256位进入模块并注册。然后通过8个阶段计算这些位的FFT。到达第8阶段时,阵列(在模块输出上打包成单个矢量)变得太大,即2560位。然后最后注册并进一步处理这些位。这是我遇到拥堵的地方。在实现过程中,设计中有大量具有重叠的节点(大约22886)。虽然路由器设法路由设计,但我在路由过程中花费了太多时间(约6-7小时)。有谁知道如何减少或消除这种拥堵问题?以上来自于谷歌翻译以下为原文I am using vivado 2014.2 on windows 7. I have a design which is facing congestion issue as shown in pink area in figure attached. In the design, I have 256 bits entering into module and get registered. Then FFT is calculated on these bits through 8 stages. By the time i reach 8th stage , the array (which is packed into a single vector on module output) gets too big i.e 2560 bits. these bits are then finally registered and further processed. This is where i am getting congestion. During implementation design has a large number of Nodes with overlaps (around 22886). Although the router managed to route the design, I am having issue of too much time taken during routing (around 6-7 hours). Does anyone have idea how to reduce or eliminate this congestion issue?

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