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  • flashdb初始化出现了问题这个怎么解决啊

    flashdb初始化出现了问题,这个怎么解决啊,是什么问题啊

    2023-01-31 15:37

  • 变量优化

    你好,PSoc creator有一个问题,其中所谓的未使用的变量被优化出来,尽管事实上,他们被写入不止一次。C编译器不应该这样做。有什么事情可以做而不必关闭优化吗? 以上来自于百度翻译 以下为原文

    2019-05-28 08:14

  • 用编码器反馈转电机,发现电机速度反馈不稳怎么解决?

    优化完电机的速度环和电流环。 用编码器反馈转电机 发现电机速度反馈不稳,偏差在2-3个左右。编码器固定良好。 优化出的P225=20 P226=0.159反复更改225大小,编码器反馈还是不稳。 如何能是速度反馈稳定?

    2023-11-23 07:42

  • 请问焊盘引出线的角度怎样才算是锐角?

    如下两图所示,一个是电容焊盘的引出线,一个是IC管脚的引出线。它们都是一边是锐角,一边是钝角。从信号流向的角度,经常听说不要走成锐角的,但好像也可以认为是钝角的吧?到底是从锐角那边流入还是钝角流入?最后面的两个图,那个才是最正确的走法?或者都不是呢?

    2019-04-15 06:05

  • 请教BGA出线问题?

    在BGA的PAD出线时,要穿过两个PAD之间,请问下规则设置时是走线设宽点还是设线到PADS的间距宽一点好? 如出线线宽设3.5mil,与焊盘的距离设4.5mil,还是做成出线线宽设4.5mil,与焊盘的距离设3.5

    2016-12-07 18:13

  • wolfssl tcp client优化出

    嘿,如果我用优化级别1编译示例项目,那么内存在MPLAB X的仪表板上显示81%。如果我用优化级别3编译这个,那么内存显示97个百分点。为什么?通过优化级别S,内存显示74%.和声版本为1.06.

    2019-09-11 08:44

  • 请问有MCP5746C的引出线工具或引出线电子表格吗?

    嗨,请问有 MCP5746C 的引出线工具或引出线电子表格吗

    2023-03-21 07:42

  • Allegro 差分对出线方式可以设置吗?

    我在走差分线的时候出线一定要走一段平行线然后才能转角度,在空间比较有限的地方很不方便,太占地方了。有些PCB的差分线在出线后马上就可以转角度,有什么地方可以设置吗?

    2016-06-29 20:45

  • 请问D19很难从焊盘中间出线是为什么?

    D19很难从焊盘中间出线是怎么回事?

    2019-03-20 07:35

  • 请问用5.5mil的线该怎么出线

    我用的5.5mil的线,8-16的过孔,芯片引脚间距0.65mil,六层板,里面有说明。自己扇出出不了线,希望老大能帮忙出出线@郑振宇_Kivy

    2019-09-01 20:20