基于FPGA的亚稳态参数测量方法_田毅
2017-01-07 21:28
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2021-04-16 08:43
在本文的第一章对跨时钟域下的同步问题和亚稳态问题做了概述。 在第二章中对时钟同步需要考虑的基本问题做了介绍。 在第三章中仔细分析了现在常用的几种同步方法。包括使用G
2011-09-06 15:24
本文分析了异步电路中亚稳态产生的原因和危害, 比较了几种常用的降低亚稳态发生概率的设计方法, 针对这些方法不能彻底消除亚稳态的不足, 设计了一种消除亚稳态的外部逻辑控制
2011-10-01 01:56
This application note provides a detailed description of themetastable behavior in PLDs from both circuit and statisticalviewpoints. Additionally, the information on the metastablecharacteristics of Cypress PLDs presented here can help youa
2012-01-17 10:40
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2021-03-30 08:45
提出一种基于异步比较法产生空满标志位，并利用锁存器实现标志位与时钟同步的 FIFO ，同时还给出了相应的VerilogHDL代码。该方法能提高时钟频率，节约版图面积。
2011-05-31 15:15
相较纯粹的单一时钟的同步电路设计，设计人员更多遇到的是多时钟域的异步电路设计。因此，异步电路设计在数字电路设计中的重要性不言而喻。本文主要就异步设计中涉及到的
2010-07-31 16:51
采用基于体布拉格光栅的窄线宽半导体激光器作为泵浦源，以电容耦合式射频激励Ar，He混合气体放电等离子体为增益介质，在双程纵向泵浦的结构下实现了连续波模式的912 nm的激光输出。
2018-02-10 11:50
异步FIFO结构及FPGA设计，解决亚稳态的问题
2015-11-10 15:21
